19秋福师《EDA技术》在线作业二(100分)

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试卷名称:福师《EDA技术》在线作业二-0004
1.综合有哪几种形式()。
A.RTL
* X; {. B$ X9 W5 i% B/ V& RB.逻辑综合
8 m3 L: R/ l4 M& i1 KC.将逻辑门表示转换到版图表示
资料:-

2.基于FPGA/CPLD器件的数字系统设计流程包括哪些阶段（）。
! k( K5 `3 p; ?+ C  p3 rA.设计输入
7 R3 w/ }1 @* s) W1 oB.综合
C.布局布线
D.仿真和编程
资料:-
+ F+ F2 X+ N: g9 g$ z/ }, B3 o4 n
3.目前的EDA技术主要特点有哪些（）。
A.使用普及
B.应用广泛
. T5 U0 _  ~" @) zC.工具多样
" W+ n6 r% H; c. [+ T2 B1 zD.软件功能强大
1 u; ]- F5 s  s2 v% c2 J6 ?资料:-

4.ASIC电路特点描述正确的是（）。
A.周期长
( h4 o% M% C! d8 NB.投入高
C.功耗低
& t( D9 q; X  W# X) u# q+ _! B- V, PD.省面积
! x& S( Q( f! E8 I3 r/ T资料:-

5.下面哪些是专业提供第三方EDA软件工具的公司（）。
A.Cadence
$ b$ P# N! A" V) `# _B.Mentor
1 o2 u" ^0 ]1 i, R" r1 dC.Synopsys
D.Synplicity
6 o' h* L, J9 j7 j! F资料:-

6.IP核一般分为哪几种（）。
- H( F- n" s4 P5 XA.硬核
' o+ \7 ~6 ^) H8 w+ w5 X2 RB.固核
C.软核
D.以上全不对
资料:-

) X9 D$ Y, h- g( a0 Z: H) w- W7.衡量仿真器性能的重要指标有哪些（）。
' {% N; ~& \" `/ t5 n1 \/ u, o" ~; {A.仿真速度
B.仿真的准确性
C.仿真的易用性
资料:-
6 ?4 i0 N: u' r0 w- W7 H' v) z8 p
8.按照处理的HDL语言类型，仿真器可以分为（）。
A.Verilog HDL仿真器
$ x7 N: F+ \- `) K1 y5 H: U2 ~B.VHDL HDL仿真器
C.混合仿真器
$ I3 F( X: L* a) T+ j' J资料:-
% v/ k* b8 u+ c
9.SPLD器件分为几类（）。
A.PROM
$ @! y4 q, p6 x: L5 YB.PLA
2 U9 y( c3 X6 [* HC.PAL
7 Q# p! P/ M' q3 J: D1 aD.GAL
资料:-

) N/ E  Q5 n& F( a! c  |10.常用的综合工具有哪些（）。
' z. V* `6 R; D; q  IA.FPGA Express
+ c* I: ]9 R' s( N$ f5 FB.FPGA compiler
C.Synplify Pro
资料:-

1.布局布线为将综合生成的电路逻辑网表映射到具体的目标器件中实现，并产生最终的可下载文件的过程。
A.错误
B.正确
' E" F( K5 o( i. e: S资料:-

2.仿真器按对设计语言的不同处理方式分为两类：编译型仿真器和解释型仿真器。
A.错误
B.正确
: L9 v, W! U2 h& `, }资料:-
/ x( q8 O' A0 |7 p
3.如果只需要在上电和系统错误时进行复位操作，采用异步复位方式比同步复位方式好。
/ [3 ^, a; |, {* K4 B) fA.错误
B.正确
$ a/ n. K. r; @6 v- K资料:-
( @/ K3 J3 n: y$ _
4.Synplify是一种FPGA/CPLD的逻辑综合工具。
1 p0 N6 {" |# K% l9 x8 k, yA.错误
B.正确
资料:-

- {) H7 t' X  s7 r5.PLD器件内部主要由各种逻辑功能部件和可编程开关构成。
1 g. N5 i7 K: a7 W% L4 LA.错误
B.正确
资料:-

2 U8 m% `: `* _6.不考虑信号时延等因素的仿真称为功能仿真。
( q. `) U/ M8 @; A; kA.错误
! \0 {1 d0 t5 T  B9 ?! r* tB.正确
资料:-
- t+ z4 e" F; Q# s: {9 p: C4 q2 L
2 |, l7 Q8 T( |* c' x7.Verilog HDL中的常量主要有：整数，实数和字符串
. Z+ g+ v2 [( XA.错误
B.正确
) c- s) j& y; H3 @) B5 D资料:-

8.CPLD和FPGA都属于高密度可编程逻辑器件。
; V# x+ d9 |0 J  S% l" m5 P- y: WA.错误
B.正确
4 M: x0 {/ U/ m! z4 w资料:-

; u( o. P2 L# b, i3 s* G. A9.Verilog HDL中assign为持续赋值语句。
A.错误
B.正确
' M5 S7 b# E% N资料:-
. h/ B; T" b2 P7 h8 C
3 v# E& C4 q9 w8 u$ ^10.综合指的是将较高级抽象层次的设计描述自动转化为较低层次描述的过程。
# k4 |6 q5 c3 `* b& `7 \A.错误
' y" H7 [/ t' d) K" M( L; Y. KB.正确
' J5 Q6 m1 I- W6 f# H2 G( i& ]资料:-

4 I4 e$ j1 D2 a) q3 h: Q11.有限状态机非常适合于数字系统的控制模块。
3 B( O2 K0 ~( _/ ~* D/ |- T! lA.错误
B.正确
8 ^4 V6 h  ^3 n7 [6 W& O, f1 ?, P资料:-

  g. N. ^( j/ S% w12.ISP和专用的编程器是FPGA常用的两种编程方式。
A.错误
5 h  |$ s& r* F4 |2 qB.正确
* L4 z0 l9 _$ H资料:-

7 w9 ~9 H9 ~/ q, W1 e3 [13.IP核中的软核与生产工艺无关，不涉及物理实现，为后续设计留有很大空间。
% k4 P4 L2 r( S# ~2 [) B! R" YA.错误
6 X9 u; a  o$ y% XB.正确
& C3 X3 _4 ~0 L" ]0 ?: F# H$ W8 N资料:-

14.IP核中的硬核可靠性高，能确保性能，能够很快投入使用。
A.错误
8 z/ }: I- l1 GB.正确
资料:-

15.CPLD是Complex Programmable Logic Device,复杂可编程逻辑器件的缩写。
A.错误
1 Y: Y6 c* {! k0 k, PB.正确
资料:-

16.解释型仿真器速度慢一些，但可以随时修改仿真环境和仿真条件。
A.错误
B.正确
$ V9 m1 J! U5 u5 j资料:-
4 `& J5 b$ S  D
; i  y$ w8 h" l17.JTAG是Joint Test Action Group, 联合测试行动组的缩写。
A.错误
3 F+ M9 O% n: G7 fB.正确
" X* i9 d1 c" U2 J资料:-

18.硬件综合器和软件程序编译器没有本质区别。
A.错误
! L( Z: {4 z0 ]B.正确
资料:-
6 n% l' p# n. K$ S3 `. L
1 Q) s6 f" d5 W! h! f4 {" d19.Verilog HDL中实数型和字符串型常量是可以综合的。
7 m; F4 E$ B$ @3 bA.错误
) [& a) O! h& o8 ?) n$ sB.正确
资料:-

20.SOC是指把一个完整的系统集成在一个芯片上。
A.错误
4 K8 r* w7 p4 |+ p8 VB.正确
" {: ]1 ^0 `7 ]) ?6 Y资料:-
5 C9 f8 M1 U$ A5 `4 M& ]" D
21.用状态机进行设计具有速度快、结构简单、可靠性高等优点。
A.错误
% @, y! Q- b2 \6 n  R/ V2 \1 lB.正确
资料:-

22.有限状态机的复位分为两种：同步复位和异步复位。
9 h) p$ O2 ^9 o: i9 ZA.错误
- L  O3 p! n, i. B& J8 mB.正确
  r# {6 v. o& G. m' a资料:-
$ J" C3 j1 m+ G# O$ e
23.编译型仿真器的仿真速度快，但需要预处理，不能即时修改。
A.错误
, h( r4 k% L. z" wB.正确
资料:-
7 m! r9 A5 W8 N6 d. p
4 ^% h+ c0 Y" y5 D0 L24.对设计而言，采用的描述级别越高，设计越容易。
, J( H  [; n# ?6 j( y0 i; R8 x- gA.错误
B.正确
资料:-

$ }7 h% x  v5 ?& D25.IP是Intellectual Property的缩写。
A.错误
' c& Y# m& `" X$ i: }- \. Z! cB.正确
资料:-
1 ]' w% O1 N" \6 K6 i( T2 h1 \
5 ]1 }1 X% k, `26.仿真是EDA的精髓所在。
A.错误
! Y. U2 n$ i2 F1 ~, G# w2 |& F* pB.正确
; M1 v$ T% }' F2 `资料:-

27.ASIC是专用集成电路的缩写。
9 k4 o& l( [/ f& X9 _8 GA.错误
B.正确
资料:-

* u: y! a3 g0 Q9 n$ j28.数据流描述方式多用于组合逻辑电路。
A.错误
7 X& M0 a* C( U+ Z$ gB.正确
资料:-

29.PLD是Programmable Logic Device,可编程逻辑器件的缩写。
- h) P4 K  f9 L- ^A.错误
" O$ l% s" y9 v' uB.正确
资料:-

30.EDA是Electronic  Design Automation,电子设计自动化的缩写。
A.错误
/ A" I7 K8 G0 F6 X3 ~0 ]B.正确
3 [% N& R: s% s! @7 W4 n3 {% B资料:-

31.FPGA是Field Programmable Gate Array,现场可编程门阵列的缩写。
A.错误
B.正确
6 N' ^" W( ?( M- u9 J% d- r+ F资料:-
7 n5 U" Y# }- S7 I* c/ V
' D8 }5 S7 q- e2 m* s- f32.PLD按照可编程的次数分为两类：一次性编程器件和可多次编程器件。
A.错误
$ f1 c5 w( K. z3 Z$ e  E. lB.正确
1 {. i% j/ l% ]. l  O; e资料:-
) K/ h- h: `- W' G& a
# K- |1 f! t: \5 L3 F33.Verilog HDL不支持条件语句。
A.错误
# @0 C$ C& Q3 J6 O: ]9 }% kB.正确
6 Z+ ]2 I- O4 q+ u2 y资料:-
  _# j! h2 p  c  T9 @
) K& _5 N6 m. K, x2 v/ ^9 _34.CAE是Computer Aided Engineering,计算机辅助工程的缩写。
A.错误
B.正确
$ K- f- m# F1 X( n$ g$ X* D资料:-

& r* k% a" C% x8 x' V: `35.有限状态机可以认为是组合逻辑和寄存器逻辑的特殊组合。
- ]6 c7 U7 u% ^# J9 sA.错误
B.正确
资料:-

36.GAL是Generic  Array Logic,通用阵列逻辑的缩写。
( b) V7 n/ e3 ^; y9 \1 QA.错误
: c) i& k+ N. W  J5 {! O% ]B.正确
资料:-

37.行为描述就是对设计实体的数学模型的描述，其抽象程度远高于结构描述。
$ K) d4 P6 f5 b7 i3 U( \A.错误
( L; k6 m' O/ u& N6 R* f+ ]0 ~B.正确
资料:-
, u8 P$ J; W# v% a5 k( U1 I+ \. x
7 `$ B) R: B: \3 |7 \. x) N38.集成度是PLD器件的一项重要指标。
A.错误
8 V2 u7 i+ r- e9 F: J& I5 qB.正确
资料:-

4 [5 p- g& ]! t& j8 I0 I39.目前常用的硬件描述语言为：Verilog HDL和 VHDL。
A.错误
: I) h& N' p1 R$ dB.正确
( Q' G8 m; V/ z; N. n1 }) i资料:-
7 l. E& }' D. v% g4 e  x* S
1 H  {( U0 O" f$ t$ e$ I$ f7 f40.把适配后生成的编程文件装入到PLD器件中的过程称为下载。
: N  g% Q2 h" n8 G; M2 {( GA.错误
B.正确
3 o  a3 {+ L7 `  o8 b- g- `3 i8 G资料:-
9 X: s! ^- ^* A& ~